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En réponse à l’adoption croissante du langage standard SystemVerilog, Mentor Graphics Corporation annonce que sa solution HDL Designer™ Series a été étendue pour fournir une plate-forme d’implémentation SystemVerilog. HDL Designer Series accélère la réutilisation des conceptions RTL et optimise les processus de saisie, synthèse et vérification de circuits intégrés (ASIC) et programmables (FPGA) complexes. Actuellement, jusqu’à 80 % des nouveaux circuits ASIC et FPGA réutilisent le code RTL des précédents designs. HDL Designer Series crée un environnement complet, de la conception à la vérification, permettant de créer et de gérer des designs complexes avec VHDL, C/C++, PSL, Verilog, des langages mixtes et maintenant SystemVerilog.

Contrairement aux langages traditionnels de description de matériel (HDL), SystemVerilog introduit une conception orientée objet associée à une pléthore de nouvelles options de langage. Les solutions comme HDL Designer Series avec SystemVerilog facilitent le travail de conception et de vérification des ingénieurs en fournissant un environnement unifié pour tous les HDL, tout en réduisant la complexité de la programmation orientée objet. Ainsi, HDL Designer Series améliore nettement la productivité des concepteurs (grâce à l’accélération/optimisation du processus de conception et à l’évaluation automatique de la qualité du code RTL), l’intégrité et l’analyse des designs, ainsi que la visualisation des designs pour une réutilisation efficace.

La solution HDL Designer s’intègre en toute transparence à d’autres flots ASIC et FPGA de Mentor Graphics, ainsi qu’à des applications telles que : simulation, vérification formelle, émulation assistée par matériel, environnements de synthèse et de placement-routage (P&R), ce qui se traduit par la réutilisation et la portabilité des designs. “Mentor s’est imposé sur le marché de l’EDA comme spécialiste de SystemVerilog, en fournissant un environnement optimal de conception et de vérification qui répond aux besoins des designs complexes actuels”, explique Mike Baird, président de Willamette HDL, société spécialisée en formation SystemVerilog. “En intégrant le support SystemVerilog à ses outils HDL, Mentor montre encore son engagement à répondre aux besoins des clients et à augmenter leur productivité.”

Parmi les autres fonctions importantes de la solution HDL Designer, citons la documentation de révisions de conception, la communication entre les groupes de conception et l’établissement d’un système d’archivage pour réutilisation ultérieure. En quelques minutes, les concepteurs peuvent créer un site Web interactif pour décrire leurs designs avec des textes et des graphiques. Ils augmentent ainsi l’efficacité de leurs projets de développement et de leurs communications.

“HDL Designer pour SystemVerilog fournit un environnement extrêmement productif et efficace de création, de réutilisation et de vérification des designs”, poursuit Glenn Perry, directeur général de la division Design Creation de Mentor Graphics. “Notre objectif consiste à accroître de façon significative la productivité des équipes de conception grâce à la réutilisation du code RTL et à l’application de nouveaux standards tels que SystemVerilog.”

HDL Designer Series avec support de SystemVerilog La solution HDL Designer Series supporte les fonctions SystemVerilog suivantes dans son édition actuelle :

 Support des langages mixtes et autres
 Assertions et rapports de couverture
 Possibilité d’instancier des composants SV1800 avec des descriptions de port compatibles V95 en V95 BD/IBD pour créer des designs structurels
 Auto-détection des langages et de la structure hiérarchique du design
 Rapports d’utilisation et de liaison
 Navigateurs hiérarchiques enrichis : blocs de programme, interfaces et instances de classes
 Modèles de fichiers pour les nouveaux objets, par exemple objets, packages et classes
 Références croisées
 Nouvelles options de gestion des performances

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