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Nouveaux produits

Silicon labs présente les puces horloges PCI express les plus petites et les plus éco énergétiques de l’industrie

Publication: Mai 2013

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Ces générateurs d’horloge PCIe pour applications grand public, embarquées, de stockage, de serveurs et de communications réduisent la consommation et simplifient la conception...
 

Silicon Labs (NASDAQ : SLAB), un leader en circuits intégrés mixtes analogiques et numériques haute densité, ajoute à son portefeuille de solutions avancées de timing PCI Express (PCIe) de nouveaux générateurs d’horloge PCIe à une et deux sorties, qui offrent la plus petite empreinte et la plus faible consommation du marché. Conçus pour se conformer aux sévères spécifications des standards PCIe Generation 1/2/3, les circuits intégrés générateurs d’horloge Si52111 et Si52112 s’adressent aux applications grand public, embarquées, de communications et d’entreprise, où la surface de carte, la consommation énergétique et le coût système sont des paramètres critiques.

Les générateurs d’horloge Si5211x de Silicon Labs s’adressent particulièrement aux produits d’électronique grand public à contraintes d’espace et d’énergie, comme les appareils photo numériques exigeant une connectivité PCIe standard. Pour répondre aux exigences de compacité de ces produits, les Si5211x sont proposés en boîtier TDFN de 3 x 3 mm à 10 broches, soit le plus petit conditionnement du marché du timing PCIe. Ces générateurs d’horloge ultra-basse puissance consomment moins de 15 mA, soit jusqu’à huit fois de courant que les produits concurrents, ce qui aide les concepteurs à suivre les réglementations vertes tout en augmentant la fiabilité système. Enfin, ces dispositifs respectent les spécifications de gigue PCIe avec une marge pouvant atteindre 50%, ce qui réduit le taux d’erreur binaire et améliore encore la fiabilité.

En plus des améliorations de consommation et de marge de gigue, les puces horloges Si5211x utilisent une technologie innovante de tampon de sortie push-pull. Contrairement aux autres solutions du marché, elles intègrent toutes les résistances de terminaison et de référence, éliminant le besoin de composants externes. Cette haute intégration contribue à réduire la nomenclature, l’espace de carte occupé et la complexité de la conception système. La plupart des solutions concurrentes exigent jusqu’à quatre résistances par sortie d’horloge, ainsi qu’une résistance de référence de source de courant. Autre avantage de l’intégration des résistances, les concepteurs sont en mesure de tracer une ligne de transmission allant directement de la sortie du Si5211x à l’entrée du récepteur, ce qui simplifie la conception de la carte et élimine les discontinuités de lignes de transmission susceptibles de dégrader l’intégrité du signal.

« L’adoption de l’interface standard PCIe dans des applications dépassant le cadre du stockage en réseau et des serveurs a créé un besoin en solutions d’horloge PCIe de petite taille, de haute intégration et d’ultra basse consommation, » déclare Mike Petrowski, vice-président et directeur général de l’activité timing de Silicon Labs. « Nous répondons à ce besoin en proposant les générateurs d’horloge PCIe les plus petits et les plus écoénergétiques de l’industrie. Malgré leur compacité, ces produits intègrent de nombreuses fonctions dans une solution monopuce qui améliore considérablement l’intégrité du signal. »

En tant que « guichet unique » leader pour les circuits intégrés de timing, Silicon Labs offre le plus large choix de solutions d’horloge compatibles PCIe de l’industrie. Son portefeuille étendu de timing PCIe inclut des générateurs et tampons d’horloge sur étagères pour les applications PCIe sensibles à la consommation et aux coûts, ainsi que des générateurs / tampons d’horloge personnalisables sur le Web, pour les conceptions à base de FPGA et de SoC exigeant divers formats d’horloge différentiels devant également se conformer au standard PCIe.

http://www.silabs.com

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