Electronique Mag - Le journal de l'électronique.
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Flux RSS . Cadence Design Systems, leader mondial de l’innovation en conception électronique, annonce que Samsung Electronics, Co., Ltd, leader technologique sur le marché de l’électronique, a déployé le flot numérique unifié de Cadence®, de RTL à GDSII, pour produire une puce de test en technologie 20 nanomètres. Le flot d’outils de Cadence et sa méthodologie basée sur Encounter® ont été associés afin de répondre aux exigences de la technologie de pointe de Samsung en 20 nanomètres destinée aux produits SoC (system-on-chip – système complet intégré sur une seule puce). Le flot a traité l’intégration et la validation d’IP, ainsi que les règles de conception complexes qu’impose la technologie 20 nanomètres.
Grâce au travail effectué en collaboration avec les ingénieurs de Cadence, Samsung a utilisé la méthodologie numérique 20 nanomètres pour la conception et la mise en œuvre d’un projet intégrant un microprocesseur Cortex™-M0 d’ ARM® et l’IP physique d’ARM Artisan®. Le résultat est la production d’une puce de test réalisée dans la technologie la plus avancée devenant ainsi une référence en matière de conception de circuits intégrés en technologie 20 nanomètres.
Cette toute dernière collaboration sur la technologie 20 nanomètres renforce les relations déjà bien établies entre Cadence et Samsung pour les conceptions de circuits intégrés en 3D, la conception favorisant la fabrication (DFM), les flots adressant les récentes technologies — notamment le flow de la synthèse RTL vers le GDSII en 32/28 nanomètres de Common Platform, et la validation signoff de la technologie basse puissance HKMG de Samsung. (High-K Metal Gate - grille métallique à haute conductivité).
Les produits de Cadence utilisés par ce flot en 20 nanomètres incluent : Encounter® Digital Implementation System, RTL Compiler, Incisive® Enterprise Simulator, Encounter Power System, QRC Extraction, Encounter Timing System, Encounter Test and Physical Verification System. Le routeur Cadence NanoRoute® a été utilisé pour le routage d’avant-garde de ce circuit en technologie 20 nanomètres.
